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| •對於以下課程，本公司保留更改之權利，將於開課前通知學員。 |
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開
課 時
間 表 |
<%
set rs = server.CreateObject("adodb.recordset")
sql = "select * from Course order by sort "
rs.Open sql,cn,1,1
do
%>
| 所需點數 |
課程名稱
天數 / 費用
適合對象 |
課程內容 |
9 月 |
10 月 |
11月 |
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Cadence IC相關課程 |
10點 |
Cadence Virtuoso Layout Editor
1天 / 費用NT$6,000(含稅) |
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未定 |
未定 |
未定 |
適合對象:基本半導體及UNIX OS概念
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10點 |
Cadence Virtuoso
XL Layout Editor
1天 / 費用NT$6,000(含稅) |
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未定 |
未定 |
未定 |
適合對象:基本半導體及UNIX OS概念
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| 10點 |
Cadence Incisive Enterprise Simulator
1天 / 費用NT$6,000(含稅) |
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未定
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未定 |
未定 |
適合對象:
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| 10點 |
Cadence Assura Verification
1天 / 費用NT$6,000(含稅) |
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未定
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未定 |
未定 |
適合對象:
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| 10點 |
Cadence Virtuoso ADE
1天 / 費用NT$6,000(含稅) |
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未定
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未定 |
未定 |
適合對象:
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| 10點 |
Cadence Design Framework II
1天 / 費用NT$6,000(含稅) |
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未定
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未定 |
未定 |
適合對象:
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Cadence OrCAD 相關課程 |
| 10點 |
Cadence OrCAD Capture 線路圖
V16.3版本
1天 / 費用NT$3,000(含稅) |
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09/14 (二)
額滿
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10/12 (二)
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11/16 (二) |
適合對象:有基本電子概念
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| 10點 |
Cadence OrCAD Capture
V16.3進階課程
半天 / 費用NT$3,000(含稅) |
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09/23(四)
下午 |
10/21(四)
下午 |
11/25 (四)
下午 |
適合對象:已有Capture使用基礎及經驗，想更了解其進階用法
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| 10點 |
Cadence OrCAD PSpice
基礎課程 - V16.3版本
1天 / 費用NT$3,000(含稅) |
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09/16(四) |
10/14(四) |
11/18(四) |
適合對象:有Capture使用基礎，想事先模擬線路功能及規格
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| 10點 |
Cadece OrCAD Capture CIS
半天 / 費用NT$3,000(含稅) |
課程內容 |
09/21(二)
下午 |
請來電洽詢
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請來電洽詢 |
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Cadence Allegro 相關課程 |
| 60點 |
Cadence Allegro 基礎課程
V16.3版本
3天 / 費用NT$18,000(含稅) |
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09/07,08,09
額滿
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10/05,06,07
額滿
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11/09,10,11
(二)~(四) |
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| 60點 |
Cadence Allegro 進階課程
V16.3版本
2天 / 費用NT$18,000(含稅) |
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09/29,30
(三)(四)
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10/19,20
(二)(三)
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11/23,24
(二)(三) |
適合對象:已有Allegro使用基礎及經驗，想更了解其進階用法
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| 60點 |
Cadence Allegro SI 基礎課程
2天 / 費用NT$18,000(含稅) |
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未定 |
未定 |
未定 |
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| 60點 |
Concept HDL 基礎課程
3天 / 費用NT$18,000(含稅) |
課程內容 |
未定 |
未定 |
未定 |
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其它課程 |
| 10點 |
WISE GerbTool
1天 / 費用NT$3,000(含稅) |
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未定 |
10/28(四)
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未定 |
適合對象:需有基本Layout輸出概念 |
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※上課時間: 9:30 AM ~ 12:00 PM ; 1:30 ~ 5:00 PM (視上課情況彈性調整)
※報名方法
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※備註:
1.報名後，服務人員將以電話通知，接到通知者才算完成報名手續
2.每班名額為18名，一人一機(特殊班別除外)
3.三日內如無接到通知，請與客服人員聯絡
4.聯絡人: Tel:(02)2995-7668 #327 吳小姐 #332 黃小姐 FAX: (02)2995-7559
5.已報名而未參加者視同棄權
6.全程禁止錄影，謝謝!
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交通工具 |
說
明 |
備
註 |
| 計
程 車 |
地址: 北縣三重市重新路五段609巷16號3F~16
電話: (02)2995-7668#332黃小姐 |
3C廣場樓上 |
| 公
車 |
台北:
台北車站
: 257、513、輔大-台北、迴龍-台北
西門町成都路 : 635、637、235、513、257、藍2
台北橋 : 616、638、639、636、801、803、泰山-台北、公西-北門
板橋車站:
板橋-淡海 (公車站-第四月台)
板橋-基隆 (公車站- 第一月台)
806 (北二出口)
|
請至中興街口站下車 |
| 汽
車 |
北一高請由五股交流道or三重交流道下北二高請由中和交流道往板橋方向經大漢橋右轉至重新路
* 機車每次20元，限當次進出有效。
*園區汽車07:00-19:00間，前3小時每半小時收費15元，超過3小時每半小時收費30元，不足30分鐘以半小時計算 |
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•Cadence IC相關課程 :
Cadence Virtuoso Layout Editor Basic |
本課程所需時間為 一天 包括的內容有:
| *Understand the Virtuoso Layout Editor Environment |
| *Edit layout designs |
| *Use path stitching |
| *Edit the properties of objects |
| *Export your finished designs for mask making |
| *Edit your designs with Virtuoso Layout Editor Turbo |
| *Design layouts with quick cell devices |
| *Create and edit a layout in a design-rule-correct manner using design-rule-driven (DRD) editing |
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| TOP |
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Cadence Virtuoso Layout Editor Advance |
本課程所需時間為 二天 包括的內容有:
| 第一天 |
| *Introduction to Virtuoso XL Layout Editor |
| *Generate a layout from a schematic |
| *Editing Virtuoso XL placement |
| *Create interconnect manually |
| *Create interconnect using the Wire Editor |
| 第二天 |
| *Analyze and update your design |
| *Set up and complete a hierarchical design |
| *Abstract your designs with the Abstract Generator |
| *Virtuoso Custom Placer Setup |
| *Pin placement with Virtuoso Custom Placer |
| *Placement styles and automatic placement |
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| TOP |
|
•Cadence OrCAD相關課程 :
Cadence OrCAD Capture 線路圖 |
本課程所需時間為 一天 包括的內容有:
| *建立新零件 |
*建立新工作檔 |
| *多張式平坦電路的應用 |
*圖檔間的複製在利用 |
| *零件名稱編輯 |
*DRC圖面檢查 |
| *跨頁連結的應用Adding intersheet signal references |
*產生零件清單及其他報表 |
| *宣告零件及訊號屬性 |
*產生連線關係到LAYOUT程式 |
| *階層式設計的應用 |
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| TOP |
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| |
Cadence OrCAD Captrue V16.0進階課程 |
本課程所需時間為 半天 包括的內容有:
| *Create part |
| -Create multiple part（Heterogeneus part） |
-New part create from spreadsheet |
| -Delete part per package manipulation for heterogeneous part |
-Split part symbol generation |
| *Library correction utility |
| -Verify / Correct library component name and number for Allegro |
| *Editor Schematic |
| -Selection Filter |
-Global replace |
| -Dynamic port/pin update on hierarchical blocks |
-Replace Cache |
| *Annotate |
| -Perform annotation of heterogeneous part |
-Push Occurrence properties into Instance utility |
| *Create netlist |
| -Graser Allegro netlist |
|
| *Other |
| -Q＆A |
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| TOP |
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| |
Cadence OrCAD PSpice 基礎課程 |
本課程所需時間為 一天 包括的內容有:
| *Basic Analysis |
| -直流分析DC Analysis |
-交流分析AC Analysis |
| -暫態分析Tran Analysis |
-基本分析的應用Application |
| *Advanced Analysis |
| -參數調變分析 Parameter Analysis |
-蒙第卡羅分析 Monte Carlo Analysis |
| -溫度分析Temperature Analysis |
最壞情況分析Worse Case Analysis |
| *Digital Circuit |
| -組合邏輯電路 Combination Logic Circuit |
-數位最壞情況時序分析 Digital Worst Case Timing Analysis |
| -序向邏輯電路Sequential Logic Circuit |
-自動偵錯功能 |
| -Q&A |
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| •Cadence Allegro相關課程 : |
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Cadence Allegro基礎課程 |
本課程所需時間為 三天 包括的內容有:
| 第 一 天 |
| *Allegro環境介紹Allegro ENV |
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| -設定工作環境setup Work Directory |
-控制台/滑鼠/手繪式指令stoke |
| -群組設定/物件高量/查詢物件 |
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| *檔案類型介紹File format |
*錄影檔的使用Scripts |
| *Env 與 Preference 設定介面 |
*skill的載入及使用 |
| *銲點的建立Pad Stack |
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| 第 二 天 |
| *零件建立Component |
|
| -精靈自動建立Wizard |
-手動建立零件Manual |
| *板框設計Board Design |
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| -手動繪制Manual |
.DXF / IDF機構轉入 |
| -板框建立精靈Board Wizard |
|
| *載入連線關係Netlist |
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| -整合式Allegro 載入連線關係 |
-傳統式載入連線關係3rd Party Import |
| *擺放零件Placement |
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| -快速擺放零件Quick |
-手動擺放零件Manual |
| 萃取零件Export Lib |
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| *設定設計規範Design Rule |
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| *佈線及整線Routing and Glossing |
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| -修線,整線Slide |
-自動佈線/自動整線Autorouter/Glossing |
| 第 三 天 |
| *鋪銅 Copper |
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| -負片銅/正片銅 Negative / Positive plane |
-銅箔切割 Split Plane |
| -銅箔設定/編輯/修改/挖銅 Copper editing |
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| *零件名稱重編 Rename |
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| -自動重編 auto rename |
-手動零件編名 Manual rename |
| *回編至線路圖 Back annotation |
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| -新轉法之allegro回編 |
-傳統回編rename.log的編輯和使用 |
| *轉出生產檔案 Manufacturing |
*自動加測試點auto testpoint |
| *自動文字面修 整auto silkscreens |
*各式報表之產生 Reports |
| *轉出底片檔 Artwork |
*鑽頭表之產生N/C legend |
| *載入底片檔import art |
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| TOP |
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| |
Cadence Allegro進階課程 |
本課程所需時間為 二天 包括的內容有:
| 第
一 天 |
| *Allegro
載入連線關係應用 |
|
| -整合式OrCAD
Capture到Allegro新轉法 |
-傳統式
3rd Party Import轉法 |
| *擺放零件Placment |
|
| -依區域考量By
Areas |
-零件外型變換Alt
Symbol |
| -依零件擺放檔By
Placement file |
-邏輯閘/零件腳更換連線關係Swap
gate pins compoent |
| *設定佈線規則Set
Rule |
|
| -差動訊號之應用Differential
Pair |
-其他佈線規則之宣告Other
properities |
| 第
二 天 |
| *佈線相關應用
Route |
|
| -貼圖/併圖 Sub-drawing |
-自動調線長 Elongation |
| *其它
Other |
|
| -設計規範管理環境 CM |
-各種重複使用的應用 Allegro Reuse |
| -模組使用的方式 Module |
|
| *問題與討論
Q&A |
|
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| TOP |
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| |
Cadence Allegro SI 基礎課程 |
本課程所需時間為 二天 包括的內容有:
| 第 一 天 |
| *Allegro PCB SI Design Flow: Pre-Placement |
| *Topology Extraction |
|
| *Determine and Apply Constraints |
|
| 第 二 天 |
| *Crosstalk Simulation in SigXplorer and Constraint-Driven Placement |
| *Post-Route DRC and Post-Route Analysis |
| *Differential Signal Design Using Allegro PCB SI |
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| TOP |
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| •其它課程 : |
| |
WISE GerbTool課程 |
本課程所需時間為 一天 包括的內容有:
| *載入底片檔data
input |
*檔案格式轉換鏡頭列表檔自動對應Data
Exchange |
| *底片檔之分析檢查Analysis |
*底片檔之檢查及比對Check
/ Compare |
| *底片資料之編輯Modify |
*自動排版Panelize |
| *生產資料輸出Fabrication
Data Export |
*檔案預覽及列印Print
Feature |
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| TOP |
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